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【ACZ7015开发板】搭载两个AD7606C模块,16通道同时采集,通过UDP以太网输出

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  • TA的每日心情
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    2024-3-7 11:10
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    发表于 2024-9-29 14:36:05 | 显示全部楼层 |阅读模式
    程序里面使用了两块ACM7606C模块逻辑,所以硬件也需要插接两块ACM7606C模块,只接一块数据回不来,




    ACZ7015开发板搭载两个AD7606C模块,同时采集相同通道,通过以太网同时输出。
    使用网络调试助手进行指令下发,将以太网接收到的数据以文件形式保存。使用MATLAB进行波形绘制。

    程序中,将两个模块的数据按照ABAB样式,交替发送。这里提供可以将接收到的数据,拆分为两个通道的波形。(下面回复提供16通道采集源码)


    AXZ7015+7606C+7606C

    AXZ7015+7606C+7606C

    采集显示

    采集显示


    【产品资料】【扩展模块】ACM7606 型8通道16位ADC模块资料
    http://www.corecourse.cn/forum.php?mod=viewthread&tid=28681
    (出处: 芯路恒电子技术论坛)






    提供ddr版本和FIFO版本源码和2通道波形绘制文件
    DDR版本: ad7606C_udp_ddr3.zip (3.7 MB, 下载次数: 977)   

    FIFO版本: ad7606C_udp_rgmii.zip (261.77 KB, 下载次数: 920)   
    波形绘制文件: Dual_channel_display_7606C.zip (1.42 KB, 下载次数: 266)









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  • TA的每日心情
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     楼主| 发表于 2024-9-30 17:12:27 | 显示全部楼层
    基于ACZ7015开发板,搭载两块AD7606C模块。在原来2通道基础上修改而来。扩展为16通道同时采集,交替写入ddr或者FIFO中,然后通过UDP发回给电脑,通过matlab绘制16通道波形。

    16ch.png
    【产品资料】【扩展模块】ACM7606 型8通道16位ADC模块资料
    http://www.corecourse.cn/forum.php?mod=viewthread&tid=28681
    (出处: 芯路恒电子技术论坛)


    提供16通道ddr版本和FIFO版本和16通道绘制文件
    FIFO版本: ad7606C_udp_rgmii_16ch.zip (356.75 KB, 下载次数: 819)        
    DDR版本: ad7606C_udp_ddr3_16ch.zip (3.72 MB, 下载次数: 896)      
    波形绘制文件:
    16_channel_display_7606C.zip (1.47 KB, 下载次数: 234)






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  • TA的每日心情
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    2021-2-24 10:16
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    发表于 2024-9-30 18:23:50 | 显示全部楼层
    makabaka 发表于 2024-9-30 17:12
    在原来2通道基础上修改而来。扩展为16通道同时采集,交替写入ddr或者FIFO中,然后通过UDP发回给电脑,通过m ...

    基于哪个主板的
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  • TA的每日心情
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     楼主| 发表于 2024-9-30 22:04:26 | 显示全部楼层
    admin 发表于 2024-9-30 18:23
    基于哪个主板的

    本贴提供的工程都是基于ACZ7015开发板                                                                    
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     楼主| 发表于 2024-10-22 12:25:18 | 显示全部楼层
    大家要注意,不同版本的以太网调试助手,在接收到保存文件设置会有不同,比如我这里使用的,进来就是默认数据文件格式,其他的可能默认是日志模式。一定要注意修为数据模式,
    微信截图_20241022122431.png
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    发表于 2025-2-27 19:44:01 | 显示全部楼层
    请问一下,多通道同时采集网络调试助手发送的指令是什么,需要多次发送指令吗?我看图片中显示的指令好像是采集1通道的。楼主能教一下吗?
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    难过
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    发表于 2025-3-4 14:31:23 | 显示全部楼层
    你好,请问我直接用的ddr3的版本,使用的vivado是2018.3的版本,ACZ7015开发板  ,报错如下。主要表现是ddr3和fixed io的大部分管脚的电平是default,请问您知道是什么原因吗 微信图片_20250304143049.png
    微信图片_20250304142730.png
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  • TA的每日心情
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     楼主| 发表于 2025-3-4 14:47:49 | 显示全部楼层
    user1122 发表于 2025-3-4 14:31
    你好,请问我直接用的ddr3的版本,使用的vivado是2018.3的版本,ACZ7015开发板  ,报错如下。主要表现是ddr ...

    你这个不用管,7015属于ZYNQ系列,DDR在PS那边,我们没法认为控制DDR
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    难过
    2025-3-4 16:08
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    发表于 2025-3-4 16:08:42 | 显示全部楼层
    makabaka 发表于 2025-3-4 14:47
    你这个不用管,7015属于ZYNQ系列,DDR在PS那边,我们没法认为控制DDR

    100多个严重警告都是因为这个,没关系吗?
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