有关智多晶FPGA SA5Z-30-D1硬核CM3时钟的几点疑惑

高胜友 · 发表于 2022-6-7 18:13:00

近些日子在学习国产的FPGA，有关CM3时钟有点疑惑。烦请小梅哥和各位指教。十分感谢！

如下是手册中有关时钟输入的截图。

（1）CLK_PAD是来自于芯片的外部引脚，但手册上CM3的时钟引脚应该是位于C3脚位的DIFF_RX_C10N，手册中给出的PT19D是什么意思？

（2）CIB_CLK，我的理解是时钟输入模块，不知是否正确？

（3）其余几个时钟选择PLL_USRCLK、CLK_TREE和PLL_OUT分别来自于哪里？如果我想选择它们之中的一个作为CM3的时钟，例化的时候应该如何选择？

高胜友 · 发表于 2022-6-8 16:08:59

十分感谢您的解答。对于问题1和问题2，我完全明白了。对于正常使用应该没有问题了。但对于问题3，我还是有点小疑问。这款芯片内部有晶振吗？主频是多少？另外，CLK_TREE指的是哪个时钟呢？有关这款芯片的时钟，是否有更详细一点的文档呢？我刚入手这款芯片，资料还没有看全，请多见谅和指教。十分感谢！

admin · 发表于 2022-6-8 10:42:05

问题1：PT19D是我们内部命名，对应的就是DIFF_RX_C10N；
问题2：CIB是逻辑内部互连线的缩写，可以用PLL过来的时钟，也可以用管脚输入的；
问题3：xsCM3的原语中有个参数param.coreclk可选择时钟来源，其中PLL_OUT是内部晶振输出的时钟，PLL_USRCLK是PLL输出的时钟。

神经蛙_by40 · 发表于 2022-8-15 23:48:43

这个用户指南在哪里下载？我怎么没有找到呢？官网没有呀

神经蛙_by40 · 发表于 2022-11-1 14:53:06

有没有时钟方面的详细讲解？还是有些迷惑

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