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关于SDRAM引脚数不足报错的问答

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  • TA的每日心情
    开心
    昨天 07:23
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    发表于 2018-6-29 08:09:18 | 显示全部楼层 |阅读模式
    本帖最后由 fzwwj95 于 2018-6-29 08:11 编辑

    来源:芯路恒FPGA客户专属群 286285840

    【问】
    嘉文四世(594717378) 9:32:33
    小梅哥 这是什么情况啊 我运行的源码啊

    QQ图片20180629080749.jpg
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  • TA的每日心情
    可爱
    2018-6-30 17:47
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    发表于 2018-6-29 12:37:18 | 显示全部楼层
    这个例子是SDRAM控制器设计实验,主要通过仿真来验证控制器设计是否正确,不属于应用型代码,由于引出信号较多,因此全编译会报错,解决这个问题,一种方案是选择引脚更多的片来编译,二种是使用虚拟引脚功能,啥是虚拟引脚,咋使用,百度就有。
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  • TA的每日心情
    开心
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     楼主| 发表于 2018-7-5 07:19:07 | 显示全部楼层
    admin 发表于 2018-6-29 12:37
    这个例子是SDRAM控制器设计实验,主要通过仿真来验证控制器设计是否正确,不属于应用型代码,由于引出信号 ...

    学习了,谢谢小梅哥耐心解答
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