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【提问】可否用FPGA 产生差分时钟替代 200Mhz 差分晶振 fzwwj95 2018-11-6 1303 admin 2018-11-7 09:53
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【求助】用verilog描述上拉电阻的问题 新人帖 Sunshine7337 2018-10-14 4384 Sunshine7337 2018-10-16 11:15
【精彩】关于UDP千兆以太网发送程序丢包的分析探讨 admin 2018-6-20 31310 小馬哥 2018-9-30 11:54
双口RAM对指定地址的内容读写问题 新人帖 changge531 2018-9-6 2524 小馬哥 2018-9-30 11:22
FPGA与STM32数据传输问题 changge531 2018-9-10 7742 lzl51113212 2018-9-20 21:55
【Modelsim】 出不来波形界面就卡主了,无任何报错提示 新人帖 attachment tlm_init106 2018-9-16 3518 asuyyy 2018-9-19 08:12
在Modelsim仿真中显示状态机名称的3种方法 attach_img 挣钱买刀 2018-9-16 0513 挣钱买刀 2018-9-16 21:18
AC620板子上DDS信号发生器输出最高频率如何确定 新人帖 E=mc² 2018-9-12 2485 fzwwj95 2018-9-13 07:09
基于FPGA的数字识别三 attach_img lee神 2018-7-31 4806 laidaihua 2018-9-3 19:16
signaltap II综合assign语句的问题 平漂流 2018-8-10 3433 laidaihua 2018-9-3 16:21
同步fifo的读写使能问题 attach_img 平漂流 2018-8-8 3611 laidaihua 2018-9-3 15:11
Verilog的for循环的相关问题 平漂流 2018-8-22 4592 laidaihua 2018-9-3 15:07
【分享】任意波形产生软件(可转成.mif或.hex) fzwwj95 2018-9-3 1548 fzwwj95 2018-9-3 08:08
Eclipse下载进去开发板失败 attachment 不辩者说 2018-8-13 4489 不辩者说 2018-8-13 22:27
关于AC620以太网使用的问题 新人帖 attach_img ForcePowerGA 2018-7-30 2573 slsqz 2018-8-1 07:57
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